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本文主要阐述了在深亚微米下面的逻辑综合的过程.对综合过程的主要的逻辑约束进行详细分析,并根据MCU芯片的结构特点,进行时钟的定义.同时,本文详细分析了时钟定义、电源、复位等问题的处理方法,最后达到时序收敛.再对满足时序的综合结果进行可测性设计,测试覆盖率达到99.5％.
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中国集成电路
ISSN： 1681-5289
CN： 11-5209/TN
Year： 2014
Issue： 10
Volume： 23
Page： 52-55
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